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1. 负责数字芯片SOC、NPU、ISP等模块和系统设计工作,编写设计文档,RTL实现和时序报告分析; 2. 负责各个交付节点前的质量检查包括lint/sdc/cdc/clp等; 3. 参与芯片综合,DFT,配合后端的设计和实现; 4. 参与芯片测试方案和支持芯片测试工作。
1. 微电子/电子/通信/计算机/自动化等相关专业,硕士及以上学历; 2. 了解数字电路设计和时序逻辑设计等相关技术; 3. 熟悉Verilog RTL设计语言,有实际FPGA/ASIC项目经验优先; 4. 了解脚本语言及相关工具开发经验者优先; 5. 具备数字芯片综合/时序分析(STA)经验优先; 6. 正直诚信、有责任心和团队合作精神。



